Vitis コード開発キットの実行モデルの要件を満たすには、RTL カーネルが カーネル プロパティ の要件に従っている必要があります。RTL カーネルには、カーネル ロジックにクロックを提供するために、少なくとも 1 つのクロック インターフェイス ポートが必要です。次の表に、さまざまなインターフェイスの要件を示します。
重要: ポート名を厳密に同じに記述する必要がある場合もあります。
ポートまたはインターフェイス | 説明 | コメント |
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ap_clk | プライマリ クロック入力ポート |
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ap_clk_2 | セカンダリ クロック入力ポート |
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ap_rst_n | プライマリ アクティブ Low リセット入力ポート |
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ap_rst_n_2 | オプションのセカンダリ アクティブ Low のリセット入力 |
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interrupt | アクティブ High の割り込み。 |
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s_axi_control | 唯一の AXI4-Lite スレーブ制御インターフェイス |
注記: * ポートは通常必須ですが、フリーランニング カーネル などの例外もあます。
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AXI4_MASTER | グローバルメモリにアクセスするための 1 つ以上の AXI4 マスター インターフェイス |
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AXI4_STREAM | カーネル間やホストアプリケーションとカーネル間で一方向のデータを転送するための 1 つまたは複数の AXI4-Stream インターフェイスです。 |