デバッグ コアを生成したら、HDL ソースにインスタンシエートし、デバッグ用にプローブする信号に接続します。次に、Verilog HDL ソース ファイルの ILA インスタンスの例を示します。
u_ila_0
(
.clk(clk),
.probe0(counterA),
.probe1(counterB),
.probe2(counterC),
.probe3(counterD),
.probe4(A_or_B),
.probe5(B_or_C),
.probe6(C_or_D),
.probe7(D_or_A)
);
注記: 新しい ILA コア インスタンスでは、レガシ VIO および ILA v1.x コアとは異なり、ICON コア インスタンスへの接続は必要ありません。その代わりにデバッグ コア ハブ デバッグ (
dbg_hub
) が合成済みデザイン ネットリストに自動的に挿入され、新しい ILA コアと JTAG スキャン チェーンが接続されます。