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Vitis 统一软件平台文档 嵌入式软件开发 (UG1400)

Document ID
UG1400
Release Date
2022-04-26
Version
2022.1 简体中文

为配置提供唯一名称。下一步,在Main view(主视图)中设置以下详细信息:

FPGA Device
自动选中该选项。
PS Device
自动选中该选项。
Hardware Platform
为您的设计选择硬件平台。
Bitstream file
搜索或浏览您的比特流文件。
FSBL FileInitialization File
基于是否选中相应的复选框来选择 FSBL 文件或初始化 (Initialization) 文件。默认情况下,选中Use FSBL Flow for Initialization(使用 FSBL 流程进行初始化)复选框(仅限 ZYNQ 和 ZYNQ UltraScale+)。
Reset Entire System
如果系统中仅有 1 个处理器,则执行系统复位。
Initialize Using FSBL file
使用 FSBL 文件初始化 PS。
Reset APU
复位所有 APU 处理器核。
Reset RPU
复位所有 RPU 处理器核。
Enable RPU Split Mode
将 RPU 核置于拆分模式下,以便独立使用每个 RPU 核。
Program FPGA
用于执行比特文件编程。
Skip Revision Check
启用该选项将在执行比特流编程时跳过器件版本。