このセクションでは、System Generator トークンで HDL Netlist を選択して Generate ボタンをクリックしたときに System Generator で生成される下位ファイルについて説明します。生成されるファイルには、デザインをインプリメントする HDL が含まれます。System Generator では、HDL ファイルとその他のハードウェア ファイルが 1 つの Vivado® IDE プロジェクトで管理されます。すべてのファイルは、System Generator トークンで指定したディレクトリに生成されます。テストベンチを作成するよう指定していない場合 ([Create testbench] をオフ)、System Generator で生成されるファイルは次のとおりです。
ファイル名/タイプ | 説明 |
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<design_name>.vhd/.v
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階層構造ネットリストとクロック/クロック イネーブル制御が含まれます。 |
<design_name_entity_declarations>.vhd/.v
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デザインの System Generator ブロックのモジュール定義のエンティティが含まれます。 |
<design_name>.xpr
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Vivado IDE デザインの属性をすべて記述した Vivado IDE プロジェクト ファイル。 |
テストベンチを作成するよう指定している場合は ([Create testbench] をオン)、System Generator で上記のファイルに加え、シミュレーション結果を比較するためのファイルが生成されます。 Simulink® でのシミュレーション結果と、ModelSim、Vivado シミュレータ、Model、VCS などの Vivado® IDE でサポートされる RTL シミュレータからのシミュレーション結果が比較されます。追加のファイルは次のとおりです。
ファイル名/タイプ | 説明 |
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DAT ファイル | Simulink でのシミュレーション結果が含まれます。 |
<design_name>_tb.vhd/.v
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デザインをラップするテストベンチ。シミュレーションを実行すると、このテストベンチによりデジタル シミュレータのシミュレーション結果と Simulink のシミュレーション結果が比較されます。 |