プロジェクトを作成するには New Project ウィザードを使用し、プロジェクト名を指定し、RTL ソース ファイルおよび制約ファイルを追加し、ターゲット デバイスを指定します。
- Vivado Design Suite 統合設計環境 (IDE) を開きます。
- [Getting Started] ページで Create Project をクリックして New Project ウィザードを開きます。
- Next をクリックします。
- [Project Name] ページで次を実行します。
- [Project name] に新しいプロジェクト名
project_ECO_lab
を入力します。 - [Project location] に
C:/Vivado_Tutorial
と入力します。 - [Create project subdirectory] がオンになっていることを確認します。
- Next をクリックします。
- [Project name] に新しいプロジェクト名
- [Project Type] ページで次を実行します。
- 作成するプロジェクトのタイプを RTL Project に指定します。
- [Do not specify sources at this time] チェック ボックスはオフのままにします。
- Next をクリックします。
- [Add Sources] ページで次を実行します。
- [Target Language] を [Verilog] に設定します。
- Add Files をクリックします。
- [Add Source Files] ダイアログ ボックスで /src/lab4 ディレクトリに移動します。
- すべての Verilog ソース ファイルを選択します。
- OK をクリックします。
- ファイルが追加されたことを確認します。
- Add Files をクリックします。
- [Add Source Files] ダイアログ ボックスで /src/lab4/IP ディレクトリに移動します。
- すべての XCI ソース ファイルを選択し、OK をクリックします。
- ファイルが追加され、Copy sources into project がオンになっていることを確認します。
- Next をクリックします。
- [Add Constraints] ページで次を実行します。
- [Add] ボタン をクリックし、Add Files をクリックします。
- /src/lab4 ディレクトリに移動して ECO_kcu105.xdc を選択します。
- Next をクリックします。
- [Default Part] ページで次の操作を実行します。
- Boards をクリックし、Kintex-UltraScale KCU105 Evaluation Platform を選択します。
- Next をクリックします。
- [New Project Summary] ページを確認します。上記の手順で設定したとおりにデータが表示されていることを確認します。
-
Finish をクリックします。注記: プロジェクトの初期化に少し時間がかかる場合があります。
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Vivado IDE の [Sources] ウィンドウで top を展開し、この演習のソース ファイルを確認します。